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Lattice Semiconductor
Figure 2-1. Core Block Diagram for the Classic TSMAC IP Core Option
rxmac_clk
txmac_clk
cpu_if_gbit_en
reset_n
Functional Description
txd_pos
txd_neg
txen
txer
rxdv_pos
tx_fifodata
tx_fifoavail
tx_fifoeof
tx_fifoempty
tx_sndpaustim
tx_sndpausreq
tx_fifoctrl
tx_staten
tx_macread
tx_statvec
tx_done
tx_disfrm
rx_fifo_full
rx_write
rx_dbout
Receive and
Transmit MAC
G/MII
Host
Interface
rxdv_neg
rxd_pos
rxd_neg
rxer_pos
rxer_neg
col
crs
hcs_n
haddr
hdatain
hdataout
hwrite_n
hread_n
hready_n
hdataout_en_n
hclk
rx_stat_vector
rx_stat_en
ignore_next_pkt
rx_eof
mdc
rx_error
rx_fifo_error
Management
Interface
mdo
mdio_en
mdi
1G or SGMII Configurable Options
For the SGMII Easy Connect configuration option, the TSMAC operates at the Gigabit data rate and uses clock
enables provided by the SGMII PCS IP core to work at the three different speeds. For the Gigabit MAC configura-
tion option, the TSMAC always operates at the Gigabit data rate and is effectively configured as a full-duplex Giga-
bit MAC only. A block diagram of the Gigabit MAC configuration or SGMII Easy Connect configuration is shown in
Figure 2-2 .
IPUG51_03.0, December 2010
8
Tri-Speed Ethernet MAC User’s Guide
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